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一般由内部时钟或者外部时钟（晶振频率）经由参考时钟和门控制器设置产生锁向环频率（FLL），再由锁项环频率分频产生时钟频率，时钟频率又经过分频产生总线频率提供给各个资源模块使用，一般总线频率为时钟频率的一半。详细请参考具体芯片的Reference Manual文档有关ICS部分描述。
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刘老师
中国人大教育学硕士
